教育部主辦
「八十九學年度大學校院積體電路電腦輔助設計軟體製作競賽」 |
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歷年題庫 |
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CAD
Data Structure |
| 編號 |
題目 |
測試檔 |
原始題目來源 |
Ｑ&Ａ |
備註 |
| 88-3 |
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|
華騰科技
SynTest Technologies, Inc. |
— |
— |
| 89-1 |
|
|
美商前達科技
Avant!, Taiwan. |
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ＴＯＰ
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CAD Algorithm |
| 編號 |
題目 |
測試檔 |
原始題目來源 |
Ｑ&Ａ |
備註 |
| 88-8 |
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荷商益華科技
Cadence, Taiwan |
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— |
ＴＯＰ
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Logic Synthesis |
| 編號 |
題目 |
測試檔 |
原始題目來源 |
Ｑ&Ａ |
備註 |
| 88-1 |
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|
思源科技
SpringSoft Inc. |
— |
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| 88-6 |
Static Timing Verification
.ps
.pdf |
|
智原科技
Faraday Technology Corp. |
|
— |
| 89-2 |
|
|
思源科技
SpringSoft Inc. |
|
— |
ＴＯＰ
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Physical Design |
| 編號 |
題目 |
測試檔 |
原始題目來源 |
Ｑ&Ａ |
備註 |
| 88-2 |
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|
美商前達科技
Avant!, Taiwan. |
|
— |
| 88-7 |
|
|
思源科技
SpringSoft Inc. |
|
— |
| 89-3 |
K-Way Netlist Partitioning
.ps
.pdf |
|
智原科技
Faraday Technology Corp. |
|
— |
| 89-4 |
Reduced Gridless Routing Problem
.ps
.pdf |
|
思源科技
SpringSoft Inc. |
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— |
ＴＯＰ
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|
Timing Issue |
| 編號 |
題目 |
測試檔 |
原始題目來源 |
Ｑ&Ａ |
備註 |
| 88-6 |
Static Timing Verification
.ps
.pdf |
|
智原科技
Faraday Technology Corp. |
|
— |
| 89-5 |
IP Timing Characterization
.ps
.pdf |
|
創意電子
Global UniChip |
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— |
| 89-6 |
|
|
智原科技
Faraday Technology Corp. |
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— |
ＴＯＰ
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Testing |
| 編號 |
題目 |
測試檔 |
原始題目來源 |
Ｑ&Ａ |
備註 |
| 88-4 |
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|
華騰科技
SynTest Technologies, Inc. |
|
— |
| 88-5 |
Fully-decoder Identification for the Bus-contention Problem
.ps
.pdf |
|
華騰科技
SynTest Technologies, Inc. |
— |
— |
| 89-7 |
User-Defined Primitive (UDP) modeling
.ps
.pdf |
|
華騰科技
SynTest Technologies, Inc. |
— |
— |
| 89-8 |
Pattern Generator for Built-In Self-Test
.ps
.pdf |
|
華騰科技
SynTest Technologies, Inc. |
|
— |
ＴＯＰ
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|
Others |
| 編號 |
題目 |
測試檔 |
原始題目來源 |
Ｑ&Ａ |
備註 |
| 89-9 |
Area Filling (TACD--Process variation)
.ps
.pdf |
|
荷商益華科技
Cadence, Taiwan |
|
— |
ＴＯＰ
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